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Creating and Programming Configuration Images for Parallel Flash
Creating and Programming Configuration Images for Parallel
Flash
Due to the high fanout of the CCLK signal on the Starter Kit board, it is recommended that
the FPGA CCLK frequency be set to 1 MHz when creating FPGA configuration images for
the parallel Flash. See UG332 for information on typical configuration clock speeds
supported for custom boards.
Refer to the “ Master BPI Mode ” chapter in the Spartan-3 Generation Configuration User Guide
for information on how to create and format FPGA configuration images for parallel Flash.
To program the parallel Flash memory, see the associated design example.
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UG332: Spartan-3 Generation Configuration User Guide
www.xilinx.com/support/documentation/user_guides/ug332.pdf
Design Example: Programmer for the STMicroelectronics M29DW323DT Parallel
NOR Flash
www.xilinx.com/products/boards/s3astarter/reference_designs.htm#parallel_flash
_programmer
Related Resources
Refer to the following links for additional information:
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STMicroelectronics M29DW323DT 32 Mbit Parallel NOR Flash PROM
www.numonyx.com/Documents/Datasheets/M29DW323D.pdf
Design Example: Programmer for the STMicroelectronics M29DW323DT Parallel
NOR Flash
www.xilinx.com/products/boards/s3astarter/reference_designs.htm#parallel_flash
_programmer
Spartan-3A/3AN FPGA Starter Kit Board User Guide www.xilinx.com
UG334 (v1.1) June 19, 2008
89
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